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本文給出了一種采用Altera公司的Cyclone系列EP1C12Q240C8的FPGA芯片設(shè)計(jì)磁盤陣列校驗(yàn)卡的硬件電路的方法。該設(shè)計(jì)采用了并行的思想,令數(shù)據(jù)在PCI總線上的傳輸過程和校驗(yàn)計(jì)算過程在時間上重疊,使得整個校驗(yàn)過程耗費(fèi)的時間等同于數(shù)據(jù)在總線上傳輸?shù)臅r間,從而最大限度地提高了校驗(yàn)性能。設(shè)計(jì)經(jīng)軟件仿真和硬件實(shí)現(xiàn),結(jié)果表明電路性能可靠。