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更新時間:2025.03.22
一種具有掉電數(shù)據(jù)保持功能的觸發(fā)器設計

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提出了一種用相變器件作為可擦寫存儲單元的具有掉電數(shù)據(jù)保持功能的觸發(fā)器電路.該觸發(fā)器由四部分組成:具有恢復掉電時數(shù)據(jù)的雙置位端觸發(fā)器DFF、上電掉電監(jiān)測置位電路(Power On/Off Reset)、相變存儲單元的讀寫電路(Read Write)和Reset/Set信號產生電路,使之在掉電時能夠保存數(shù)據(jù),并在上電時完成數(shù)據(jù)恢復.基于0.13μm SMIC標準CMOS工藝,采用Candence軟件對觸發(fā)器進行仿真,掉電速度達到0.15μs/V的情況下,上電時可以在30ns內恢復掉電時的數(shù)據(jù)狀態(tài).

基于R-SET結構的邏輯門電路和觸發(fā)器設計

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提出一種基于單電子晶體管的新型電路結構——R-SET結構,并從R-SET結構的反相器著手對該結構電路的工作原理和性能進行了分析.構造出基于R-SET結構的或非門、一位數(shù)值比較器、SR鎖存器和D觸發(fā)器.通過對各電路進行SPICE仿真,驗證了各電路的正確性.最后對R-SET和互補型SET 2種結構的D觸發(fā)器進行性能比較,得出R-SET結構的D觸發(fā)器具有結構簡單,功耗低,延時小的特點.

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