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提出了基于FPGA對(duì)SATA硬盤(pán)數(shù)據(jù)進(jìn)行AES加解密的方法。對(duì)算法進(jìn)行了改進(jìn)和優(yōu)化,以降低加解密過(guò)程對(duì)SATA硬盤(pán)數(shù)據(jù)傳輸速度的影響。
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隨著信息時(shí)代的到來(lái),數(shù)據(jù)存儲(chǔ)和保護(hù)的需求與日俱增,如何有效實(shí)現(xiàn)對(duì)硬盤(pán)數(shù)據(jù)的加密保護(hù)成為一個(gè)重要的課題。文章首先分析了目前常用的硬盤(pán)數(shù)據(jù)加密方法,并在比較各種加密方案的基礎(chǔ)上給出了基于FPGA的SATA硬盤(pán)加解密控制器設(shè)計(jì)方案。基于SATA2.0接口的廣泛應(yīng)用性,文章接著介紹了SATA的體系結(jié)構(gòu),并由此給出了系統(tǒng)的總體設(shè)計(jì)構(gòu)架和詳細(xì)設(shè)計(jì)方案。本控制器采用Synopsys公司的SATA VIP輔助驗(yàn)證,測(cè)試平臺(tái)為Xilinx ML505開(kāi)發(fā)板,并采用Xilinx公司的Virtex-5FPGA作為最終實(shí)現(xiàn),測(cè)試結(jié)果表明能夠正確有效地實(shí)現(xiàn)硬盤(pán)數(shù)據(jù)的加解密工作。在SATA加解密控制器設(shè)計(jì)與實(shí)現(xiàn)方面的研究成果,具有通用性、可移植性,有一定的理論及經(jīng)濟(jì)價(jià)值。
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