上拉電阻

百度一下上拉電阻與下拉電阻，一堆一堆的解釋就出來(lái)了，不過(guò)，好像沒(méi)有一個(gè)解釋的通熟易懂的，可能是寫(xiě)解釋的人水平太高了，說(shuō)的話(huà)小白聽(tīng)不懂。

我來(lái)給你來(lái)點(diǎn)通熟易懂的解釋吧。

上拉電阻與下拉電阻用在什么場(chǎng)合？

答：用在數(shù)字電路中，存在高低電平的場(chǎng)合。

上拉電阻與下拉電阻怎么接線(xiàn)？

上拉電阻：電阻一端接VCC，一端接邏輯電平接入引腳（如單片機(jī)引腳）

下拉電阻：電阻一端接GND，一端接邏輯電平接入引腳（如單片機(jī)引腳）

如上圖，R13和R14，一端接到了3.3V,一端通過(guò)J17連接到單片機(jī)引腳，這兩個(gè)電阻就是上拉電阻。

如上圖，R18的一端連接到了GND,一端連接到了單片機(jī)的引腳（只不過(guò)是串了一個(gè)電阻后連接到了單片機(jī)引腳）。所以這個(gè)就是下拉電阻。

上拉電阻和下拉電阻有什么用？

1.提高驅(qū)動(dòng)能力：

例如，用單片機(jī)輸出高電平，但由于后續(xù)電路的影響，輸出的高電平不高，就是達(dá)不到VCC，影響電路工作。所以要接上拉電阻。下拉電阻情況相反，讓單片機(jī)引腳輸出低電平，結(jié)果由于后續(xù)電路影響輸出的低電平達(dá)不到GND，所以接個(gè)下拉電阻。

2.在單片機(jī)引腳電平不定的時(shí)候，讓后面有一個(gè)穩(wěn)定的電平：

例如上面接下拉電阻的情況下，在單片機(jī)剛上電的時(shí)候，電平是不定的，還有就是如果你連接的單片機(jī)在上電以后，單片機(jī)引腳是輸入引腳而不是輸出引腳，那這時(shí)候的單片機(jī)電平也是不定的，R18的作用就是如果前面的單片機(jī)引腳電平不定的話(huà)，強(qiáng)制讓電平保持在低電平。

再這么解釋一下吧，如果IE_DATA那個(gè)地方，不連接任何引腳，那么由于R18的下拉作用，IE_DATA就是低電平，所以三極管就不會(huì)導(dǎo)通。

不知道你清楚了沒(méi)有？

1、上拉就是將不確定的信號(hào)通過(guò)一個(gè)電阻嵌位在高電平！“電阻同時(shí)起限流作用”！下拉同理！

2、上拉是對(duì)器件注入電流，下拉是輸出電流

3、弱強(qiáng)只是上拉電阻的阻值不同，沒(méi)有什么嚴(yán)格區(qū)分

4、對(duì)于非集電極（或漏極）開(kāi)路輸出型電路（如普通門(mén)電路）提升電流和電壓的能力是有限的，上拉電阻的功能主要是為集電極開(kāi)路輸出型電路輸出電流通道。

上拉電阻作用

1、一般作單鍵觸發(fā)使用時(shí)，如果IC本身沒(méi)有內(nèi)接電阻，為了使單鍵維持在不被觸發(fā)的狀態(tài)或是觸發(fā)后回到原狀態(tài)，必須在IC外部另接一電阻。

2、數(shù)字電路有三種狀態(tài)：高電平、低電平、和高阻狀態(tài)，有些應(yīng)用場(chǎng)合不希望出現(xiàn)高阻狀態(tài)，可以通過(guò)上拉電阻或下拉電阻的方式使處于穩(wěn)定狀態(tài)，具體視設(shè)計(jì)要求而定！

3、一般說(shuō)的是I/O端口，有的可以設(shè)置，有的不可以設(shè)置，有的是內(nèi)置，有的是需要外接，I/O端口的輸出類(lèi)似與一個(gè)三極管的C，當(dāng)C接通過(guò)一個(gè)電阻和電源連接在一起的時(shí)候，該電阻成為上C拉電阻，也就是說(shuō)，如果該端口正常時(shí)為高電平；C通過(guò)一個(gè)電阻和地連接在一起的時(shí)候，該電阻稱(chēng)為下拉電阻，使該端口平時(shí)為低電平，作用嗎：比如：“當(dāng)一個(gè)接有上拉電阻的端口設(shè)為輸入狀態(tài)時(shí)，他的常態(tài)就為高電平，用于檢測(cè)低電平的輸入”。

4、上拉電阻是用來(lái)解決總線(xiàn)驅(qū)動(dòng)能力不足時(shí)提供電流的。一般說(shuō)法是拉電流，下拉電阻是用來(lái)吸收電流的，也就是我們通常所說(shuō)的灌電流

5、接電阻就是為了防止輸入端懸空

6、減弱外部電流對(duì)芯片產(chǎn)生的干擾

7、保護(hù)cmos內(nèi)的保護(hù)二極管，一般電流不大于10mA

8、通過(guò)上拉或下拉來(lái)增加或減小驅(qū)動(dòng)電流

9、改變電平的電位，常用在TTL-CMOS匹配

10、在引腳懸空時(shí)有確定的狀態(tài)

11、增加高電平輸出時(shí)的驅(qū)動(dòng)能力。

12、為OC門(mén)提供電流。

上拉電阻在電路中的主要作用就是對(duì)電流起到限流作用，在一些設(shè)計(jì)當(dāng)中經(jīng)常會(huì)用到上拉與下拉電阻，但電源的設(shè)計(jì)者們往往對(duì)這兩種電阻了解的不多，正因如此，在電路出現(xiàn)因?yàn)樯侠c下拉電阻而導(dǎo)致的問(wèn)題時(shí)，設(shè)計(jì)者們卻會(huì)找不到相應(yīng)的解決方法。在本篇文章當(dāng)中，小編將為大家分享關(guān)于上拉電阻的一些基礎(chǔ)知識(shí)與經(jīng)驗(yàn)，希望能為大家有所幫助。

上拉電阻經(jīng)驗(yàn)總結(jié)

1、當(dāng)TTL電路驅(qū)動(dòng)COMS電路時(shí)，如果TTL電路輸出的高電平低于COMS電路的最低高電平(一般為3.5V)，這時(shí)就需要在TTL的輸出端接上拉電阻，以提高輸出高電平的值。

2、OC門(mén)電路必須加上拉電阻，才能使用。

3、為加大輸出引腳的驅(qū)動(dòng)能力，有的單片機(jī)管腳上也常使用上拉電阻。

4、在COMS芯片上，為了防止靜電造成損壞，不用的管腳不能懸空，一般接上拉電阻產(chǎn)生降低輸入阻抗，提供泄荷通路。

5、芯片的管腳加上拉電阻來(lái)提高輸出電平，從而提高芯片輸入信號(hào)的噪聲容限增強(qiáng)抗干擾能力。

6、提高總線(xiàn)的抗電磁干擾能力。管腳懸空就比較容易接受外界的電磁干擾。

7、長(zhǎng)線(xiàn)傳輸中電阻不匹配容易引起反射波干擾，加上下拉電阻是電阻匹配，有效的抑制反射波干擾。

上拉電阻阻值的選擇原則

從灌電流的能力與節(jié)約能源的考慮出發(fā)，應(yīng)具備電阻大，電流小的特點(diǎn)。從節(jié)約功耗及芯片的灌電流能力考慮應(yīng)當(dāng)足夠大;電阻大，電流小。從確保足夠的驅(qū)動(dòng)電流考慮應(yīng)當(dāng)足夠小;電阻小，電流大。對(duì)于高速電路，過(guò)大的上拉電阻可能邊沿變平緩。

在10K到1K之間，適用于以上三點(diǎn)。對(duì)下拉電阻也有類(lèi)似道理。對(duì)上拉電阻和下拉電阻的選擇應(yīng)結(jié)合開(kāi)關(guān)管特性和下級(jí)電路的輸入特性進(jìn)行設(shè)定，主要需要考慮以下幾個(gè)因素：

1、驅(qū)動(dòng)能力與功耗的平衡。以上拉電阻為例，一般地說(shuō)，上拉電阻越小，驅(qū)動(dòng)能力越強(qiáng)，但功耗越大，設(shè)計(jì)是應(yīng)注意兩者之間的均衡。

2、下級(jí)電路的驅(qū)動(dòng)需求。同樣以上拉電阻為例，當(dāng)輸出高電平時(shí)，開(kāi)關(guān)管斷開(kāi)，上拉電阻應(yīng)適當(dāng)選擇以能夠向下級(jí)電路提供足夠的電流。

3、高低電平的設(shè)定。不同電路的高低電平的門(mén)檻電平會(huì)有不同，電阻應(yīng)適當(dāng)設(shè)定以確保能輸出正確的電平。以上拉電阻為例，當(dāng)輸出低電平時(shí)，開(kāi)關(guān)管導(dǎo)通，上拉電阻和開(kāi)關(guān)管導(dǎo)通電阻分壓值應(yīng)確保在零電平門(mén)檻之下。

4、頻率特性。以上拉電阻為例，上拉電阻和開(kāi)關(guān)管漏源級(jí)之間的電容和下級(jí)電路之間的輸入電容會(huì)形成RC延遲，電阻越大，延遲越大。上拉電阻的設(shè)定應(yīng)考慮電路在這方面的需求。

本篇文章對(duì)上拉電阻的相關(guān)經(jīng)驗(yàn)與選擇原則進(jìn)行了介紹，在這其中，對(duì)上拉電阻的選擇是本篇文章的重點(diǎn)內(nèi)容，希望大家能夠利用本篇文章當(dāng)中的知識(shí)點(diǎn)運(yùn)用到自己的設(shè)計(jì)中去，豐富自己的知識(shí)儲(chǔ)備。